Cadence PCB仿真使用Allegro PCB SI进行数字电路毛刺容差设置的方法图文教程

news2024/11/11 6:35:18

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目录

  • 1, 概述
  • 2,配置方法
  • 3,总结


1, 概述

    数字信号的波形往往不是完美的低和高电平,经常会有一些毛刺。这在信号完整性仿真中也经常遇到,为了保证仿真顺利进行需要对接收电路的毛刺容差进行设置。本文简单介绍其配置方法。
在这里插入图片描述


2,配置方法

第1步:打开待仿真的PCB文件,并确认软件为Allegro PCB SI
如果,打开软件不是Allegro PCB SI则可这样切换
执行File→Change E

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