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GIC结构
获取GIC中断控制器基地址
方法一：查询芯片数据手册
方法二：查询cp15协处理器
CBAR寄存器
SCTLR 寄存器
VBAR寄存器
GIC用于管理单核或多核芯片中的中断资源
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ARM公司开发了4 个版本GIC规范 ，V1~V4
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ARMv7-A内核搭配GIC-400使用
GIC结构
GIC官方手册：ARM® Generic Interrupt Controller
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V2最多支持 8 个内核
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三类信号源：
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软件中断：用于多核通信，ID0~ID15
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私有中断：内核独有的中断，ID16~ID31
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共享中断：所有内核共享的中断，ID32~ID1019
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分发器：选择把中断信号发送到哪一个cpu接口单元
有哪些相关寄存器？
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中断数量：GICD_TYPER
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中断清除： GICD_ ICENABLERn
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中断使能：GICD_ISACTIVERn
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中断优先级设置：GICD_IPRIORITYR
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cpu接口单元：处理信号后，发送信号给CPU
有哪些相关寄存器？
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中断优先级数量：GICC_PMR
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抢占优先级和子优先级设置： GICC_BPR
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保存中断ID：GICC_IAR
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通知cpu中断完成：GICC_EOIR
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获取GIC中断控制器基地址
方法一：查询芯片数据手册
方法二：查询cp15协处理器
共有16个：c0~c15。每个协处理器本身有多种含义，需逐步配置
//设置并读协处理器
MRC {cond} p15, <opc1>, <Rn>, <CRn>, <CRm>, <opc2>
//设置并写协处理器
MCR {cond} p15, <opc1>, <Rn>, <CRn>, <CRm>, <opc2>
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cond：执行条件，一般省略
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opc1：第一层设置
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Rn：通用寄存器
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CRn：要设置的协处理器
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CRm：第二层设置
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opc2：第三层设置
B3.17 Oranization of the CP15 registers in a VMSA implementation
CBAR寄存器
CRn=c15，opc1=4，CRm=c0，opc2=0
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GIC的地址
MRC p15, 4, r1, c15, c0, 0 ;获取 GIC 基地址SCTLR 寄存器
CRn=c1，opc1=0，CRm=c0，opc2=0
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bit13：中断向量表基地址
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MRC p15, 0, <Rt>, c1, c0, 0 ;读取 SCTLR 寄存器，数据保存到 Rt 中。 MCR p15, 0, <Rt>, c1, c0, 0 ;将 Rt 中的数据写到 SCTLR(c1)寄存器中。
VBAR寄存器
CRn=c12，opc1=0，CRm=c0，opc2=0
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bit5~31：中断向量表偏移地址
MRC p15, 0, <Rt>, c12, c0, 0 ;读取 VBAR 寄存器，数据保存到 Rt 中。 MCR p15, 0, <Rt>, c12, c0, 0 ;将 Rt 中的数据写到 VBAR寄存器中。
