前言
在早期计算机和嵌入式系统中，图形显示和用户界面的实现主要依赖于硬件技术。VGA（视频图形阵列）标准在1980年代中期成为主流图形显示技术，其高分辨率和良好的兼容性使其在计算机显示领域中占据了重要地位。VGA标准支持640x480的分辨率，能够显示256种颜色，成为了计算机显示的基础之一。与此同时，ROM（只读存储器）作为一种重要的存储器件，广泛应用于存储固定程序和数据。在计算机系统中，ROM被用于存储固化的系统BIOS、启动程序以及一些特定的数据表。由于ROM具有非易失性，其存储的数据在断电后仍能保留，这使得它非常适合用于存储不需要频繁更改的数据。基于ROM的VGA显示技术结合了这两种技术的优势，通过将显示控制程序或图形数据存储在ROM中，系统能够快速、稳定地驱动VGA显示器。这种方法尤其适用于嵌入式系统、工业控制和教育领域，其中对系统稳定性和显示效果有较高的要求。在这种系统中，ROM不仅用于存储显示控制程序，还可以存储预定义的图形数据。这些数据可以是静态的图标、字符集或图像，通过VGA接口传输到显示器上，呈现给用户。这种方式减少了对实时图形生成的依赖，提高了系统的响应速度和稳定性。
正文
一、基于ROM的VGA显示的设计验证
1.项目需求
设计基于ROM的VGA显示方案，对一100*100的彩色图片进行显示。
2.技术介绍
首先需要将目标图片数据转化为基于RGB的颜色数据，这里使用一张像素为100*100的图片作为演示，100*100，使用RGB332编码方式数据宽度为8bit，数据深度10000；
使用matlab进行数据提取
DEPIH = 10000;
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ADDRESS RADIX = HEX;
DATA RADIX = HEX;
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9669 :29 ;
9670 :29 ;
9671 :29 ;
9672 :29 ;
9673 :29 ;
9674 :29 ;
9675 :29 ;
9676 :29 ;
9677 :29 ;
9678 :29 ;
9679 :29 ;
9680 :29 ;
9681 :29 ;
9682 :29 ;
9683 :29 ;
9684 :29 ;
9685 :29 ;
9686 :29 ;
9687 :29 ;
9688 :29 ;
9689 :29 ;
9690 :29 ;
9691 :29 ;
9692 :29 ;
9693 :29 ;
9694 :29 ;
9695 :29 ;
9696 :29 ;
9697 :29 ;
9698 :29 ;
9699 :29 ;
9700 :bb ;
9701 :bb ;
9702 :bb ;
9703 :bb ;
9704 :bb ;
9705 :bb ;
9706 :bb ;
9707 :bb ;
9708 :ff ;
9709 :ff ;
9710 :ff ;
9711 :ff ;
9712 :ff ;
9713 :ff ;
9714 :ff ;
9715 :ff ;
9716 :ff ;
9717 :ff ;
9718 :ff ;
9719 :ff ;
9720 :ff ;
9721 :df ;
9722 :df ;
9723 :db ;
9724 :db ;
9725 :bb ;
9726 :bb ;
9727 :bb ;
9728 :bb ;
9729 :bb ;
9730 :bb ;
9731 :bb ;
9732 :bb ;
9733 :bb ;
9734 :bb ;
9735 :bb ;
9736 :bb ;
9737 :bb ;
9738 :bb ;
9739 :bb ;
9740 :bb ;
9741 :ff ;
9742 :ff ;
9743 :ff ;
9744 :db ;
9745 :fb ;
9746 :ff ;
9747 :ff ;
9748 :ff ;
9749 :b6 ;
9750 :ff ;
9751 :db ;
9752 :bb ;
9753 :db ;
9754 :db ;
9755 :ff ;
9756 :ff ;
9757 :ff ;
9758 :ff ;
9759 :ff ;
9760 :ff ;
9761 :ff ;
9762 :fb ;
9763 :96 ;
9764 :bb ;
9765 :bb ;
9766 :bb ;
9767 :b7 ;
9768 :72 ;
9769 :29 ;
9770 :29 ;
9771 :29 ;
9772 :29 ;
9773 :29 ;
9774 :29 ;
9775 :29 ;
9776 :29 ;
9777 :29 ;
9778 :29 ;
9779 :29 ;
9780 :29 ;
9781 :29 ;
9782 :29 ;
9783 :29 ;
9784 :29 ;
9785 :29 ;
9786 :29 ;
9787 :29 ;
9788 :29 ;
9789 :29 ;
9790 :29 ;
9791 :29 ;
9792 :29 ;
9793 :29 ;
9794 :29 ;
9795 :29 ;
9796 :29 ;
9797 :29 ;
9798 :29 ;
9799 :29 ;
9800 :bb ;
9801 :bb ;
9802 :bb ;
9803 :bb ;
9804 :bb ;
9805 :bb ;
9806 :bb ;
9807 :db ;
9808 :ff ;
9809 :ff ;
9810 :ff ;
9811 :ff ;
9812 :ff ;
9813 :ff ;
9814 :ff ;
9815 :ff ;
9816 :ff ;
9817 :ff ;
9818 :ff ;
9819 :ff ;
9820 :ff ;
9821 :df ;
9822 :df ;
9823 :db ;
9824 :db ;
9825 :db ;
9826 :bb ;
9827 :bb ;
9828 :bb ;
9829 :bb ;
9830 :bb ;
9831 :bb ;
9832 :bb ;
9833 :bb ;
9834 :bb ;
9835 :bb ;
9836 :bb ;
9837 :db ;
9838 :bb ;
9839 :bb ;
9840 :bb ;
9841 :db ;
9842 :df ;
9843 :ff ;
9844 :ff ;
9845 :db ;
9846 :fb ;
9847 :ff ;
9848 :ff ;
9849 :da ;
9850 :ff ;
9851 :df ;
9852 :db ;
9853 :db ;
9854 :bb ;
9855 :b7 ;
9856 :b7 ;
9857 :db ;
9858 :ff ;
9859 :ff ;
9860 :ff ;
9861 :ff ;
9862 :ff ;
9863 :b6 ;
9864 :b7 ;
9865 :bb ;
9866 :bb ;
9867 :97 ;
9868 :4e ;
9869 :29 ;
9870 :4e ;
9871 :b7 ;
9872 :b6 ;
9873 :4d ;
9874 :92 ;
9875 :29 ;
9876 :29 ;
9877 :29 ;
9878 :29 ;
9879 :29 ;
9880 :29 ;
9881 :29 ;
9882 :29 ;
9883 :29 ;
9884 :29 ;
9885 :29 ;
9886 :29 ;
9887 :29 ;
9888 :29 ;
9889 :29 ;
9890 :29 ;
9891 :29 ;
9892 :29 ;
9893 :29 ;
9894 :29 ;
9895 :29 ;
9896 :29 ;
9897 :29 ;
9898 :29 ;
9899 :29 ;
9900 :bb ;
9901 :bb ;
9902 :bb ;
9903 :bb ;
9904 :bb ;
9905 :bb ;
9906 :bb ;
9907 :ff ;
9908 :ff ;
9909 :ff ;
9910 :ff ;
9911 :ff ;
9912 :ff ;
9913 :ff ;
9914 :ff ;
9915 :ff ;
9916 :ff ;
9917 :ff ;
9918 :ff ;
9919 :ff ;
9920 :ff ;
9921 :ff ;
9922 :ff ;
9923 :df ;
9924 :df ;
9925 :df ;
9926 :db ;
9927 :bb ;
9928 :bb ;
9929 :bb ;
9930 :bb ;
9931 :bb ;
9932 :bb ;
9933 :bb ;
9934 :bb ;
9935 :bb ;
9936 :db ;
9937 :df ;
9938 :db ;
9939 :bb ;
9940 :bb ;
9941 :bb ;
9942 :bb ;
9943 :ff ;
9944 :ff ;
9945 :ff ;
9946 :db ;
9947 :ff ;
9948 :ff ;
9949 :b6 ;
9950 :df ;
9951 :df ;
9952 :db ;
9953 :db ;
9954 :bb ;
9955 :bb ;
9956 :bb ;
9957 :bb ;
9958 :92 ;
9959 :92 ;
9960 :ff ;
9961 :ff ;
9962 :ff ;
9963 :ff ;
9964 :92 ;
9965 :bb ;
9966 :bb ;
9967 :bb ;
9968 :97 ;
9969 :97 ;
9970 :97 ;
9971 :b6 ;
9972 :b6 ;
9973 :bb ;
9974 :92 ;
9975 :29 ;
9976 :29 ;
9977 :29 ;
9978 :29 ;
9979 :29 ;
9980 :29 ;
9981 :29 ;
9982 :29 ;
9983 :29 ;
9984 :29 ;
9985 :29 ;
9986 :29 ;
9987 :29 ;
9988 :29 ;
9989 :29 ;
9990 :29 ;
9991 :29 ;
9992 :29 ;
9993 :29 ;
9994 :29 ;
9995 :29 ;
9996 :29 ;
9997 :29 ;
9998 :29 ;
9999 :29 ;
END;基于该数据设置对应的IP核rom
原理讲解参考前几章VGA显示字符
3.顶层架构
4.端口描述
| clk | 板载时钟（50Mhz） |
| rst_n | 复位按键（低电平有效） |
| vga_hs | 行脉冲信号 |
| vga_vs | 场脉冲信号 |
| [7:0] vga_rgb | 颜色数据信号，高三位表示红色， 中间三位表示绿色，低两位表示蓝色 |
| [9:0]vga_v | x坐标 |
| [9:0]vga_h | y坐标 |
二、代码验证
matlab代码
clear %清零命令窗口
clc %清理工作区
image_array = imread('abc.bmp');%图片输入
[height,width,z] = size(image_array);%100*100*3
red = image_array(:,:, 1);%红色分量提取
ger = image_array(:,:, 2);%绿色分量提取
blu = image_array(:,:, 3);%蓝色分量提取
r = uint32(reshape(red , 1 , height * width));g = uint32(reshape(ger , 1 , height * width));
b = uint32(reshape(blu , 1 , height * width));
% rgb矩阵初始化
rgb = zeros( 1 ,height*width);
% 导入的图片为24bit真彩色图片，每个像素占用24bit，RGB888
% 将RGB888转换为RGB332
% 红色分量右移5位取出高3位, 左移5位作为ROM中RGB数据的第7bit到第5bit
% 绿色分量右移5位取出高3位, 左移2位作为ROM中RGB数据的第4bit到第2bit
% 蓝色分量右移6位取出高2位，左移0位作为ROM中RGB数据的第1bit到第0bit
for i = 1:height*width
rgb(i) = bitshift(bitshift(r(i),-5),5)+bitshift(bitshift(g(i),-5),2)+bitshift(bitshift(b(i),-6),0);
end
fid = fopen ('image.mif', 'w+');%新建文件
%字符串打印
fprintf(fid,'DEPIH = %d;\n',height*width );%深度
fprintf(fid,'WIDIH = 8;\n');%位宽
fprintf(fid,'ADDRESS RADIX = HEX;\n');%地址
fprintf(fid,'DATA RADIX = HEX;\n');%数据
fprintf(fid,'%s\n\t','CONTENT');
fprintf(fid,'%s\n','BEGIN');
for i = 1:height*width
fprintf(fid,'\t%d\t:%x\t;\n',i-1,rgb(i));
end
fprintf(fid,'\tEND;');
fclose(fid);
VGA驱动模块
module vga_ctrl_v1
(
input wire vga_clk ,
input wire sys_rst_n ,
input wire [7:0] pix_data ,
output wire [9:0] pix_x ,
output wire [9:0] pix_y ,
output wire hsync ,
output wire vsync ,
output wire [7:0] vga_rgb
);
parameter H_SYNC = 10'd96 ,//同步
H_BACK = 10'd40 ,//后沿
H_LEFT = 10'd8 ,//左边框
H_VALID = 10'd640,//有效图像
H_RIGHT = 10'd8 ,//右边框
H_FRONT = 10'd8 ,//前沿
H_TOTAL = 10'd800;//同步+后沿+左边框+有效图像+右边框+前沿
parameter V_SYNC = 10'd2 ,//同步
V_BACK = 10'd25 ,//后沿
V_TOP = 10'd8 ,//上边框
V_VALID = 10'd480,//有效图像
V_BOTTOM= 10'd8 ,//底边框
V_FRONT = 10'd2 ,//前沿
V_TOTAL = 10'd525;//总共
reg [9:0] cnt_h ;
reg [9:0] cnt_v ;
wire pix_data_req;
wire rgb_valid ;
always@(posedge vga_clk or negedge sys_rst_n)
if(sys_rst_n == 1'b0)
cnt_h <= 10'd0;
else if(cnt_h == H_TOTAL - 1'b1)
cnt_h <= 10'd0;
else
cnt_h <= cnt_h + 1'b1;
always@(posedge vga_clk or negedge sys_rst_n)
if(sys_rst_n == 1'b0)
cnt_v <= 10'd0;
else if((cnt_v == V_TOTAL - 1'b1) && (cnt_h == H_TOTAL - 1'b1))
cnt_v <= 10'd0;
else if(cnt_h == H_TOTAL - 1'b1)
cnt_v <= cnt_v + 1'b1;
else
cnt_v <= cnt_v;
assign rgb_valid = ((cnt_h >= H_SYNC + H_BACK + H_LEFT)
&& (cnt_h < H_SYNC + H_BACK + H_LEFT + H_VALID)
&&(cnt_v >= V_SYNC + V_BACK + V_TOP)
&&(cnt_v < V_SYNC + V_BACK + V_TOP + V_VALID))
? 1'b1 : 1'b0;
assign pix_data_req = ((cnt_h >= H_SYNC + H_BACK + H_LEFT - 1'b1)
&& (cnt_h < H_SYNC + H_BACK + H_LEFT + H_VALID - 1'b1)
&&(cnt_v >= V_SYNC + V_BACK + V_TOP)
&&(cnt_v < V_SYNC + V_BACK + V_TOP + V_VALID))
? 1'b1 : 1'b0;
assign pix_x = (pix_data_req == 1'b1) ? (cnt_h - (H_SYNC + H_BACK + H_LEFT - 1'b1)) : 10'h3ff;
assign pix_y = (pix_data_req == 1'b1) ? (cnt_v - (V_SYNC + V_BACK + V_TOP)) : 10'h3ff;
assign hsync = (cnt_h <= H_SYNC - 1'b1) ? 1'b1 : 1'b0;
assign vsync = (cnt_v <= V_SYNC - 1'b1) ? 1'b1 : 1'b0;
assign vga_rgb = (rgb_valid == 1'b1) ? pix_data : 8'h0000;
endmodule数据生成模块
module vga_data(
input clk ,
input rst_n ,
input[9:0] pix_x ,
input[9:0] pix_y ,
output [7:0] vga_rgb_t
);
parameter show_h = 10'd110,//定位点X坐标
show_v = 10'd100;//定位点Y坐标
parameter pot_h = 10'd120,//定位点X坐标
pot_v = 10'd100;//定位点Y坐标
parameter show_chan = 10'd256,//图片长度
show_kuan = 10'd32;//图片宽度
parameter chan = 10'd100,//图片长度
kuan = 10'd100;//图片宽度
parameter show_1_rgb = 8'b000_000_00,//背景
show_0_rgb = 8'b111_100_00;//图片颜色
reg [255:0] char [31:0];//字符存储
wire[9:0] char_x;//字符坐标
wire[9:0] char_y;
wire rd_en ;//ip核读使能
reg[13:0]addr;//ip核地址
wire[7:0]top_vga_rgb;//图片数据
reg[7:0]vga_rgb;//字符背景
assign char_x =((pix_x >= show_h)&&(pix_x < (show_h + show_chan)))&&((pix_y >= show_v)&&(pix_y <(show_v + show_kuan)))?(pix_x - show_h):10'h3ff;
assign char_y =((pix_x >= show_h)&&(pix_x < (show_h + show_chan)))&&((pix_y >= show_v)&&(pix_y <(show_v + show_kuan)))?(pix_y - show_v):10'h3ff;
always@(posedge clk)//显示背景
begin
char[0 ] <= 256'h0000000000000000000000000001000000200000000100000020000000010000;
char[1 ] <= 256'h0020000000010000003FFFFFFFFF0000003FFFFFFFFF0000003FFFFFFFFF0000;
char[2 ] <= 256'h003FFFFFFFFF0000003000180001000000300018000100000030001800010000;
char[3 ] <= 256'h0030001800010000003000180000000000300018000000000030001800000000;
char[4 ] <= 256'h003000180000000000300018000000000030003C000000000030007E00000000;
char[5 ] <= 256'h003803FFE00000000038000000000000003C000000000000003E000000000000;
char[6 ] <= 256'h003F8000000000000003C0000000000000006000000000000000000000000000;
char[7 ] <= 256'h0000000000000000000000000000000000000000000000000000000000000000;
char[8 ] <= 256'h0000000000000000000000000001000000200000000100000020000000010000;
char[9 ] <= 256'h0020000000010000003FFFFFFFFF0000003FFFFFFFFF0000003FFFFFFFFF0000;
char[10 ] <= 256'h003FFFFFFFFF0000003000060001000000300006000100000030000600010000;
char[11 ] <= 256'h0030000600010000003000060000000000300006000000000030000600000000;
char[12 ] <= 256'h00300006000000000038000E000000000038000E00000000001C001C00000000;
char[13 ] <= 256'h001E003C00000000000F80F800000000000FFFF8000000000007FFF000000000;
char[14 ] <= 256'h0001FFC00000000000007F000000000000000000000000000000000000000000;
char[15 ] <= 256'h0000000000000000000000000000000000000000000000000000000000000000;
char[16 ] <= 256'h00000000000000000000000000000000000000FFE000000000000FFFFE000000;
char[17 ] <= 256'h00007FFFFF8000000000FFFFFFE000000003FE001FF800000007E00000FC0000;
char[18 ] <= 256'h000F0000003C0000001E0000000E0000001C0000000600000038000000070000;
char[19 ] <= 256'h0030000000030000003000000003000000300000000300000030000100030000;
char[20 ] <= 256'h00300001000300000018000100060000001C0001800E0000001E0001FFFC0000;
char[21 ] <= 256'h001F8001FFF80000001FF001FFF8000000003801FFF800000000000180000000;
char[22 ] <= 256'h0000000100000000000000010000000000000001000000000000000000000000;
char[23 ] <= 256'h0000000000000000000000000000000000000000000000000000000000000000;
char[24 ] <= 256'h00000000000100000000000000010000000000000003000000000000001F0000;
char[25 ] <= 256'h0000000001FF0000000000001FE3000000000001FC0100000000001FC0010000;
char[26 ] <= 256'h000001FCC000000000001FC0C00000000001FC00C0000000001FC000C0000000;
char[27 ] <= 256'h003E0000C0000000007F0000C0000000007FF000C0000000003FFF00C0000000;
char[28 ] <= 256'h0001FFF0C000000000001FFFC0000000000001FFFC0100000000001FFFC10000;
char[29 ] <= 256'h00000001FFFF0000000000000FFF00000000000000FF000000000000000F0000;
char[30 ] <= 256'h0000000000030000000000000001000000000000000100000000000000000000;
char[31 ] <= 256'h0000000000000000000000000000000000000000000000000000000000000000;
end
always @(posedge clk,negedge rst_n)//背景显示区域
begin
if(rst_n == 0)
vga_rgb <= show_1_rgb;
else
if( ((pix_x >= show_h - 1'b1)&&(pix_x < (show_h + show_chan - 1'b1)))
&& ((pix_y >= show_v )&&(pix_y <(show_v + show_kuan)))
&& (char[char_y][10'd255 - char_x] == 1'b1))
vga_rgb <= show_0_rgb;
else
vga_rgb <= show_1_rgb;
end
assign rd_en = (((pix_x >= pot_h)&&(pix_x < pot_h + chan))&&((pix_y >= pot_v)&&(pix_y <pot_v + kuan)))? 1'b1:1'b0;//ip核图片显示区域
always @(posedge clk,negedge rst_n)//背景显示区域
begin
if(rst_n == 0)
addr <= 14'd0;
else
if(addr == 14'd9999)
addr <= 14'd0;
else
if(rd_en == 1'b1)
addr <= addr + 14'd1;
else
addr <= addr;
end
my_rom my_rom_inst (
.address ( addr ),
.clock ( clk ),
.rden ( rd_en ),
.q ( top_vga_rgb )
);
assign vga_rgb_t = (rd_en == 1'b1)? top_vga_rgb:vga_rgb;
endmodule 顶层连线
module vga_driver(
input clk ,
input rst_n ,
output vga_hs ,//行脉冲信号，由列计数器控制产生
output vga_vs ,//场脉冲信号，由行计数器控制产生
output[9:0] vga_h ,//坐标
output[9:0] vga_v ,//坐标
output[7:0] vga_rgb/*颜色数据信号，高三位表示红色，
中间三位表示绿色，低两位表示蓝色*/
);
wire vga_clk;//25.2mhz
wire locked;
wire [7:0]in_rgb;
my_pll my_pll_inst (
.areset ( ~rst_n ),
.inclk0 ( clk ),
.c0 ( vga_clk ),
.locked ( locked )
);
vga_ctrl_v1 vga_ctrl_inst(
.vga_clk (vga_clk) ,//vga_clk
.sys_rst_n (locked) ,
.pix_data (in_rgb) ,
.hsync (vga_hs) ,
.vsync (vga_vs) ,
.pix_x (vga_h) ,
.pix_y (vga_v) ,
.vga_rgb (vga_rgb)
);
vga_data vga_data_inst(
.clk (vga_clk ) ,
.rst_n (locked ) ,
.pix_x (vga_h ) ,
.pix_y (vga_v ) ,
.vga_rgb_t(in_rgb)
);
endmodule 仿真代码
`timescale 1ns/1ps
module vga_driver_tb;
reg clk ;
reg rst_n ;
wire vga_hs;
wire vga_vs;
wire[9:0] vga_h ;//坐标
wire[9:0] vga_v ;//坐标
wire[7:0] vga_rgb;
vga_driver vga_driver_instx(
.clk (clk) ,
.rst_n (rst_n) ,
.vga_hs (vga_hs) ,//行脉冲信号，由列计数器控制产生
.vga_vs (vga_vs) ,//场脉冲信号，由行计数器控制产生
.vga_h (vga_h) ,
.vga_v (vga_v) ,
.vga_rgb (vga_rgb)/*颜色数据信号，高三位表示红色，
中间三位表示绿色，低两位表示蓝色*/
);
initial clk = 0;
always #10 clk = ~clk;
initial begin
rst_n = 0;
#200
rst_n = 1;
#1000
$stop;
end
endmodule 三、仿真验证
进行仿真，数据输出正常，放大波形图，调出中间数据。
放大波形图，对该位置的数据进行追踪
此时vga_rgb数据输出，vga_rgb数据来自ip核rom，由此，此时Vga输出的数据来自ROM
参考资料
IP核ROM调用及验证
